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Computer Architecture Tutorial Using an FPGA: ARM & Verilog Introductions
Apprenez l'architecture informatique et bénéficiez d'une expérience pratique en utilisant un FPGA tout en étudiant à la maison. Un modèle fonctionnel de processeur ARM 32 bits est progressivement construit à partir des principes de base de l'architecture informatique. Les réseaux de portes programmables (Field Programmable Gate Arrays - FPGA) constituent des plates-formes électroniques numériques flexibles qui peuvent être organisées comme un processeur, un réseau neuronal ou presque n'importe quel autre circuit numérique. Ils sont l'équivalent numérique des métamorphes de la science-fiction.
Le FPGA est d'abord présenté graphiquement à travers des modèles opérationnels de portes logiques individuelles et de structures telles que les bus et les décodeurs. Ensuite, le codage Verilog commence par des exemples de circuits simples et se termine par une unité centrale qui exécute un code machine ARM. Les programmes peuvent même être saisis en langage d'assemblage symbolique qui est compilé en code machine ARM à 100 % par des macros, des tâches et des fonctions écrites en langage Verilog. Cette imitation d'unité centrale peut être exécutée à pleine vitesse, à l'aide de points d'arrêt ou en pause dans le cycle de récupération, de décodage et d'exécution.
Plus de 150 illustrations accompagnent les descriptions détaillées pour configurer le FPGA et parcourir chacun des quelque 100 exemples Verilog. Tous les exemples de code source peuvent être téléchargés à partir de GitHub et utilisent le logiciel Intel(R) Quartus(R) Prime ainsi qu'une carte de développement FPGA Terasic DE10-Lite. La DE10-Lite est disponible à l'achat pour moins de 100 $ sur de nombreux sites Internet, et le logiciel Intel(R) Quartus(R) Prime Lite Edition est disponible en téléchargement gratuit auprès d'Intel. D'autres cartes FPGA et d'autres logiciels Verilog peuvent être utilisés, mais de légères modifications des exemples peuvent être nécessaires.
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Dernière modification: 2024.11.14 07:32 (GMT)